PCIe 6.0介面设计规范预计在2021年时完成,主要因应越来越多显示卡等产品运算使用传输频宽,或是大量储存时候使用频宽总和需求打造,借此对应不同的运算模式,例如人工智慧,或是巨量数据分析等应用。
首波应用PCIe 4.0介面设计的SSD产品才在Computex 2019期间亮相,而PCIe 5.0规范也才刚定案没多久,PCI Special Interest Group (PCI SIG)便随即提出PCIe 6.0设计规范。
在初期的设计规范中,PCIe 6.0介面将以脉冲波振幅调变技术(Pulse-amplitude modulation),让PCIe 16组通道可提供高达每秒256GB的传输速度,相比PCIe 5.0约提升两倍,而相比PCIe 4.0则可提升四倍传输速度表现,同时也维持向下相容PCIe 5.0或PCIe 4.0介面规格。
而PCIe 6.0介面设计规范预计在2021年时完成,主要因应越来越多显示卡等产品运算使用传输频宽,或是大量储存时候使用频宽总和需求打造,借此对应不同的运算模式,例如人工智慧,或是巨量数据分析等应用。
不过,从PCIe 4.0产品才准备进入市场,而PCIe 5.0介面规范也才刚底定,预期PCIe 6.0介面要等到实际普及应用,估计也要等到2022年或2023年之后。
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